vhdl_第6页_ZKX's LAB

fpga的选型？ fpga实现广播通信

5G时代到来，哪些专业会更吃香？自己需要学习点什么？ 5G，不简单是4G的升级，它会整合工业互联网和物联网，因此，在5G时代能够发挥巨大能量的专业，可能不仅仅只是传统的通信行业的那些专业，而是泛互联网行业的各种热门专业，尤其是那些跟云计算、...

2020-07-25知识19fpga 通信 5g vhdl 5g通信
数字电子技术课程设计-------数字显示电子钟电子数字钟实验参考文献

数字钟涉及到的参考文献有哪些参考文献【1】阎石数字电子电路高等教育出版社【2】康华光电子技术基础（数字部分）高教社【3】艾永乐，付子义数字电子技术基础中国电力出版社【4】陈明义数字电子技术基础中南大学出版【5】陈明义电工电...

2020-07-24知识22时钟信号课程设计高等教育出版社数字钟 vhdl
同步预置数移位寄存器用Verilog HDL编程设计8位左右移移位寄存器电路。

HC CD HEF LS等系列的含义。 74HC Series High Speed CMOS Logic FamilyHC是高速COMS逻辑类它的逻辑电平和CMOS电路相同。74LS Series Low Power Schottky ...

2020-07-23知识33三极管移位寄存器 vhdl 触发器
利用8位移位寄存器74LS164、 165、扩展2个8位输出口和输入口求电路图和汇编语言程序各位大哥多多帮助某8位移位寄存器已装入数15H

跪求 PLC中移位寄存器指令咋用啊 MOV_B指令：2113MOV_B字节5261传送指令：将源字节IN的内4102容传送到OUT中，1653传送后，源字节内容不变。操作数：IN：VB，IB，QB，MB，SMB，AC，*AC，*VD，SB，...

2020-07-23知识23数据寄存器指令寄存器 vhdl 移位寄存器状态寄存器
VHDL怎么实现并串转换啊？我这有程序看不懂，高手给详细解释下，谢谢 vhdl串并转换仿真文件

基于vhdl的串并转换器首先，用变量时最好初始化一下 variable t：std_logic_vector(2 downto 0)：="000；要不一开始输出是个不确定值。还有就是这段写得不规范，改一下 if clk'event and...

2020-07-23知识13vhdl语言 vhdl
数字时钟 vhdl vhdl 数字钟

vhdl数字钟的代码 Hi我FPGA用VHDL语言写个数字时钟，为什么调时间的按键要个键扫描模块？因为物理按键按下后会产生一个上下抖动的波形，之后才会稳定到高或者低，一般有几十个ms，如果不加按键。数字钟VHDL程序程序启动，校时，校分使...

2020-07-22知识29时钟信号 vhdl 数字钟 vhdl语言 vector
电子时钟的国内外参考文献为什么中国古代音乐只有宫商角征羽五音，而西方是 Do-Re-Mi-Fa-Sol-La-Si 七音？

求几篇应用电子的毕业论文你看下（光电子）或者（应用物理），上面有这类的论文你可以自己去找下参考吧~都是别人已经发表成功的文献~你完全可以引用啥的从基础到临床的国外经典医学教材有哪些？不知国外怎么分科开课只求经典的权威的一些教材宗庸 ...

2020-07-21知识15vhdl 石英晶体
摄像机的数据通过FPGA，显示到显示器上是什么流程？ fpga vga显示数字时钟

用verilog 如何写vga 显示时钟你是要显示的时序吧，包括行场同步信号那些吧。设计一个数字电子钟这个我们刚做完.fpga 同步数字时钟程序可参考这个用FPGA做VGA显示，遇到几个问题，求解决！！！！ 1，可以，数据，使能，...

2020-07-21知识13vhdl语言 fpga 时钟同步 vhdl 时钟信号
跪求简易信号发生器的课程设计（还有追加的分，急盼帮忙！））简易嵌入式信号波形发生器

求vhdl实现任意波形发生器的程序，谢谢在QUARTUS中的信号仿真只能用自身的仿真工具看数字图，据我所知，如果要想在modelsim里面看模拟图像就得编写TEST BENCH文件（这个我不会），如果想直接看模拟的信号图像就在ISE中编译...

2020-07-21知识12vhdl 信号频率函数信号发生器
数电实验8位移位寄存器 vhdl怎么表示8位左右移位寄存器？

用Verilog HDL编程设计8位左右移移位寄存器电路。 module Verilog1(clk，ldn，k，d，q)；input clk，ldn，k；input[7：0]d；output[7：0]q；reg[7：0]d_reg，q_re...

2020-07-21知识16移位寄存器 vhdl

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