VHDL怎么实现并串转换啊？我这有程序看不懂，高手给详细解释下，谢谢 主要就是“shiftreg(15 downto 1)(14 downto 0)”这句话的，其他来是控制信号的。用count 来控制16位数据一次输出自的。并串转换，你zhidao的程序是16位化为16个串行的时钟输出out(15)；
基于vhdl的串并转换器 首先，用变量时最好初始化一下 variable t：std_logic_vector(2 downto 0)：=\"000；要不一开始输出是个不确定值。还有就是这段写得不规范，改一下 if clk'event and clk='1' 。
求用VHDL语言写并行输入转同步串行输出程序和仿真 【请您参考，自主完成】VHDL语言编写的串并转换模块的源代码，用来将并行输入数据转换为串行数据输出-code for the transform of ps。http：//www.pudn.com/downloads252/sourcecode/embed/detail1166489.html
用vhdl语言把八位二进制转换为十进制，怎么输出的是十六进制啊 首先我们要明确我们要干什么。我猜你是想把二进制码转成十进制的BCD码。如果你是这么想的话，那你低估这个问题的复杂程度了。你的程序我仿真的时候有点问题（可能是我的ISE。
