vhdl串并转换算法思路 用VHDL设计一个五位二进制如何转换为十进制的程序？

VHDL怎么实现并串转换啊？我这有程序看不懂，高手给详细解释下，谢谢 主要就是“shiftreg(15 downto 1)(14 downto 0)”这句话的，其他来是控制信号的。用count 来控制16位数据一次输出自的。并串转换，你zhidao的程序是16位化为16个串行的时钟输出out(15)；重金求基于FPGA的8位串并转换vhdl语言的代码！ library ieee；use ieee.std_logic_1164.all；use ieee.std_logic_arith.all；use ieee.std_logic_unsigned.all；entity sc is port(clk，rxd：in std_logic；。基于vhdl的串并转换器 首先，用变量时最好初始化一下variable t：std_logic_vector(2 downto 0)：=\"000；要不一开始输出是个不确定值。还有就是这段写得不规范，改一下if clk'event and clk='1' thenif i=3 thenDout3(2)；Dout2(1)；Dout1(0)；i：=0；elset(2 downto 0)：=t(1 downto 0)&din；i：=i+1；end if；end if；基于vhdl的串并转换器 首先，用变量时最好初始化一下 variable t：std_logic_vector(2 downto 0)：=\"000；要不一开始输出是个不确定值。还有就是这段写得不规范，改一下 if clk'event and clk='1' 。【求】串转并的VHDL语言程序 用寄存器就好了如何用VHDL编写将二进制数规格化？就是将它化为标准浮点数格式？ 本人大四狗，毕设是基于FPGA的模数转换算法设计，现在不知道如何用VHDL编写将16位二进制数转换成浮点数，…串并转换，是通过什么原理实现的啊？ 串并转换，是通过VHDL语言原理实现，将一条信息流（假如有8bits）分成两路信号的话，两路同时传输，时间就是原来时间的一半。串并转换定义：把一个连续信号元序列变换成为表示相同信息的一组相应的并行出现的信号元的过程。串并转换应用学科：通信科技（一级学科），通信原理与基本技术（二级学科）。用VHDL设计一个五位二进制如何转换为十进制的程序？ 很简单，VHDL里面有一个二进制转十进制函数CONV_IETEGER（），在UNSIGNED这个程序包里，打开它用就是了，程序如下，LIBRARY IEEE；USE IEEE.STD_LOGIC_1164.ALL；USE IEEE.STD_LOGIC_UNSIGNED.ALL；ENTITY TURN2_10 ISPORT(A：IN STD_LOGIC_VECTOR(4 DOWNTO 0)；B：OUT INTEGER RANGE 0 TO 32)；END；ARCHITECTURE ART OF TURN2_10 ISBEGINB(A)；END；

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