simulink中如何进行串并转换，要求步骤越详细越好 reshape模块和buffer模块都可以实现，主要是参数该如何设置，我用reshape模块的时候都是一个输入一个输出，如何变成四个。有谁知道怎么用数字电路实现串并转换？ 用D触发器实现就可以了，没有直接实现一位输入两位输出的专门芯片。D触发器的型号比如74LS74，用第一个D触发器的输出作为第二个D触发器的输入，用一个共同的时钟信号。第一。关于verilog实现的串并转换功能 串并转换很简单，就是移位寄存器，后面最好跟一个锁存器，实现你所要求的功能需要四位移位寄存器和四位锁存器，锁存器的作用就是保持并行数据在移位时不发生变化：module 。
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