用labview做锁相环的时候，参考时钟怎么设置 你也在做锁相环？
FPGA锁相环是不是一定要固定的时钟输入？ 一般来说是不可以变化的，也没有必要，锁相环可以倍频，你可以倍到比较大的值再在后面做分频，得到你想要的频率，这样就可以变化了啊
为什么要用锁相环
锁相环是什么？在dsp芯片中有什么作用 锁相环（pll，phase lock loop）是一个模拟电路模块，专门用于时钟信号的处理。锁相环需要一个输入的参考时钟，输出的时钟可以是输入时钟的倍频或分频，另外输出时钟的。
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为什么要用锁相环 因为它不仅能将输出频率锁定在与输入频率一样，还能使输出频率是输入频率的倍数，实现对输入信号的调制。锁相环路是一种反馈控制电路，简称锁相环(PLL)。。
数字锁相环能同时恢复出时钟信号的频率和相位，还是在给定参考时钟频率的基础之上只恢复时钟相位？ 数字锁相环最终恢复出的时钟信号频率和相位都是恒定的，还是最终恢复出的时钟信号与输入信号保持同步，频…
对于参考时钟的输入，方波和正弦波有什么区别 需要参考时钟的地方包括ARM，DSP等处理器，他们用时钟作为其内部工作时钟（内部有倍频或锁相环），所以方波会更好一点。zd另外需要参考时钟的是射频电路中的锁相环，而锁相环里面有分频器，虽然正弦波和方波区别不大，但感觉还是方波的相位准确度好一些。正版弦波在噪声的影响下权，相位准确度会变差。综上，好像参考时钟最好是方波，如果是正弦波，也是幅度尽量大一些，让边沿陡峭些。
锁相环有哪几个基本组成部分，各起什么作用 锁相环主要又压控振荡器，鉴相器，低通滤波器，以及参考频率振荡器组成。压控振主要实现电压与频率的变换，鉴相器主要实现把压控振的频率与参考频率振荡器的频率进行比较。。
